April 2024 RM0481 Rev 2 1/3152

RM0481

Reference manual

STM32H523/33xx, STM32H562/63xx, and STM32H573xx

Arm

-based 32-bit MCUs

Introduction

This document is addressed to application developers. It provides complete information on

how to use the STM32H523xx, STM32H533xx, STM32H562xx, STM32H563xx, and

STM32H573xx microcontrollers memory and peripherals.

For ordering information, mechanical and electrical device characteristics, refer to the

corresponding datasheets.

For information on the Arm

Cortex

-M33 core, refer to the corresponding Arm

Technical

Reference Manuals available on http://infocenter.arm.com.

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• STM32 Cortex

-M33 MCUs programming manual

www.st.com

Contents RM0481

2/3152 RM0481 Rev 2

Contents

1 Documentation conventions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104

1.1 General information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104

1.2 List of abbreviations for registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104

1.3 Glossary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105

2 Memory and bus architecture . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 106

2.1 System architecture . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 106

2.1.1 Fast C-bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 107

2.1.2 Slow C-bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

2.1.3 S-bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

2.1.4 DCache S-bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

2.1.5 GPDMA1 and GPDMA2 buses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

2.1.6 SDMMC1 and SDMMC2 controllers DMA buses . . . . . . . . . . . . . . . . . 108

2.1.7 BusMatrix . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

2.1.8 AHB/APB bridges . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109

2.1.9 Ethernet MAC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109

2.2 TrustZone security architecture . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109

2.2.1 Default TrustZone security state . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109

2.2.2 TrustZone peripheral classification . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

2.3 Memory organization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .115

2.3.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 115

2.3.2 Memory map and register boundary addresses . . . . . . . . . . . . . . . . . 116

2.3.3 Embedded SRAMs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 127

2.3.4 Flash memory overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 127

2.3.5 Boot modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 127

3 System security . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 129

3.1 Key security features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 129

3.2 Secure install . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130

3.3 Secure boot . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130

3.3.1 Unique boot entry . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 131

3.3.2 Immutable root of trust in system flash memory . . . . . . . . . . . . . . . . . 132

3.4 Secure update . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 132